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內容簡介

　　《FPGA數(shù)字系統(tǒng)設計/高等學校電子信息類專業(yè)系列教材》在全面介紹FPGA器件結構、Verilog語法和經典數(shù)字邏輯設計的基礎上，著重介紹基于Vivado的FPGA開發(fā)流程、基于FPGA的基礎和高級設計技術、FPGA時序約束與時序分析方法、ZynqSoC嵌入式系統(tǒng)設計，最后詳細介紹CNN手寫數(shù)字識別系統(tǒng)的設計和實現(xiàn)。《FPGA數(shù)字系統(tǒng)設計/高等學校電子信息類專業(yè)系列教材》共分兩篇：第1～5章為基礎篇，著重介紹FPGA設計的基礎知識，包括FPGA電路結構、VerilogHDL語法、經典數(shù)字邏輯設計，同時詳細講解基于Vivado的FPGA開發(fā)流程，基礎實驗涵蓋信號采集、信號傳輸、信號處理、信號輸出等信息處理全過程；第6～10章為提高篇，深入介紹FPGA的高級設計技術、FPGA的時序約束和時序分析、基于Zynq的SoC嵌入式系統(tǒng)設計，并以CNN手寫數(shù)字識別系統(tǒng)為例討論FPGA數(shù)字系統(tǒng)設計過程中的實現(xiàn)細節(jié)，綜合實驗圍繞人工智能、多媒體處理和經典數(shù)字電路展開。《FPGA數(shù)字系統(tǒng)設計/高等學校電子信息類專業(yè)系列教材》適合作為高等院校電子工程類、自動控制類、計算機類專業(yè)大學本科生、研究生的教學用書，同時可供對FPGA設計開發(fā)比較熟悉的開發(fā)人員、廣大科技工作者和研究人員參考。

作者簡介

暫缺《FPGA數(shù)字系統(tǒng)設計》作者簡介

圖書目錄

基礎篇
第1章可編程邏輯器件基礎
1．1 可編程邏輯器件概述
1．2 CPIOD的原理與結構
1．2．1 乘積項的工作原理
1．2．2 CPLD的一般結構
1．3 FPGA的原理與結構
1．3．1 查找表的基本原理
1．3．2 FPGA的結構
第2章 VerilogHDL語言基礎
2．1 硬件描述語言概述
2．2 VerilogHDL模塊的結構
2．3 VerilogHDL語言要素
2．3．1 標識符與關鍵詞
2．3．2 注釋
2．3．3 四值邏輯
2．3．4 常量及其表示
2．3．5 數(shù)據類型
2．4 表達式和運算符
2．4．1 連接與復制操作符
2．4．2 符號運算符
2．4．3 算術運算符
2．4．4 關系運算符
2．4．5 邏輯運算符
2．4．6 全等比較運算符
2．4．7 按位運算符
2．4．8 歸約運算符
2．4．9 移位操作符
2．4．10 條件運算符
2．4．11 優(yōu)先級說明
2．5 VerilogHDL的行為建模
2．5．1 行為描述的結構
2．5．2 過程結構
2．5．3 時序控制
2．5．4 賦值語句
2．5．5 條件與控制語句
2．5．6 任務與函數(shù)結構
2．5．7 可綜合與不可綜合
2．6 VerilogHDL的結構化建模
2．6．1 內置的基本門及其例化
2．6．2 模塊實例化
2．6．3 層次化設計
2．7 系統(tǒng)任務和系統(tǒng)函數(shù)
2．7．1 顯示任務
2．7．2 文件輸入／輸出任務
2．7．3 從文件中讀取數(shù)據任務
2．7．4 仿真控制任務
2．7．5 仿真時間函數(shù)
2．8 編譯指令
2．9 驗證平臺搭建
2．9．1 驗證平臺結構
2．9．2 待驗證設計
2．9．3 時鐘生成器
2．9．4 激勵發(fā)生器（Stimulator）
2．9．5 比較器（Checker）
2．9．6 驗證平臺完整實例
第3章數(shù)字邏輯HDL描述
3．1 組合邏輯電路設計舉例
3．1．1 比較器
3．1．2 編碼器
3．1．3 譯碼器
3．1．4 簡單的ALU電路
3．2 時序邏輯電路設計舉例
3．2．1 D觸發(fā)器
3．2．2 移位寄存器
3．2．3 計數(shù)器
3．2．4 分頻電路
3．3 有限狀態(tài)機設計
第4章基于Vivado的FPGA開發(fā)流程
……
提高篇