鎖相與頻率合成技術

第1章 概述
1．1 鎖相與頻率合成的基本概念
1．2 頻率合成的方式和特點
1．3 鎖相與頻率合成技術的發(fā)展
第2章 鎖相環(huán)路的工作原理
2．1 環(huán)路的基本工作原理
2．1．1 鎖相的基本概念
2．1．2 鎖相環(huán)的構成
2．1．3 環(huán)路的工作過程
2．2 鎖相環(huán)路的相位模型
2．2．1 鑒相器的相位模型
2．2．2 壓控振蕩器的相位模型
2．2．3 環(huán)路濾波器模型
2．2．4 環(huán)路的相位模型與動態(tài)方程
2．3 鎖相環(huán)路的傳遞函數(shù)
2．3．1 環(huán)路方程的線性化
2．3．2 線性環(huán)路的傳遞函數(shù)
第3章 鎖相環(huán)路的性能
3．1 鎖相環(huán)路的線性跟蹤性能
3．1．1 環(huán)路的頻率響應
3．1．2 環(huán)路對典型輸入相位的跟蹤性能
3．2 鎖相環(huán)路的穩(wěn)定性
3．2．1 環(huán)路穩(wěn)定性判據(jù)
3．2．2 常用二階環(huán)的穩(wěn)定性
3．3 鎖相環(huán)路的捕獲特性
3．3．1 環(huán)路捕獲的性能指標與分析方法
3．3．2 一階環(huán)的捕獲過程
3．3．3 二階環(huán)的捕獲過程
3．3．4 輔助捕捉方法
3．4 鎖相環(huán)路的噪聲性能分析
3．4．1 輸入加性噪聲的環(huán)路相位模型
3．4．2 環(huán)路對加性噪聲的線性過濾性能
3．4．3 存在輸入噪聲環(huán)路的非線性性能
第4章 鎖相環(huán)路的應用
4．1 在調(diào)制解調(diào)技術中的應用
4．1．1 鎖相調(diào)制器
4．1．2 調(diào)頻調(diào)相解調(diào)器
4．1．3 同步檢波器
4．1．4 抑制載波的相干解調(diào)器
4．2 在載波提取與位同步技術中的應用
4．2．1 相干載波提取鎖相環(huán)
4．2．2 位同步鎖相環(huán)
4．3 在測速與測距技術中的應用
4．3．1 鎖相接收機
4．3．2 跟蹤測距鎖相環(huán)
第5章 頻率合成的方案
5．1 頻漂抵消合成法
5．2 脈沖取樣鎖相環(huán)
5．3 數(shù)字單環(huán)頻率合成器
5．3．1 單環(huán)合成器的相位模型
5．3．2 單環(huán)合成器的雜散干擾
5．3．3 單環(huán)合成器的噪聲分析
5．3．4 混頻環(huán)
5．4 多環(huán)數(shù)字頻率合成器
5．4．1 雙環(huán)數(shù)字頻率合成器
5．4．2 三環(huán)數(shù)字頻率合成器
第6章 鎖相頻率合成器的基本電路
6．1 鑒相器
6．1．1 二極管平衡鑒相器
6．1．2 取樣保持鑒相器
6．1．3 開關型鑒相器
6．1．4 鑒頻鑒相器
6．2 壓控振蕩器
6．2．1 壓控振蕩器的主要技術指標
6．2．1 LC壓控振蕩器
6．2．2 晶體壓控振蕩器
6．3 可變分頻器
6．3．1 可變分頻器的主要技術指標
6．3．2 可變分頻器的工作原理
6．3．3 提高可變分頻器速度的方法
6．3．4 減法可變分頻器
6．3．5 吞脈沖技術
第7章 小數(shù)分頻頻率合成器
7．1 小數(shù)分頻合成器的工作原理
7．1．1 小數(shù)分頻器的實現(xiàn)方法
7．1．2 雙模分頻器控制信號的產(chǎn)生
7．1．3 小數(shù)分頻環(huán)中鑒相器的輸出電壓
7．2 改善輸出頻譜純度
7．2．1 可變延遲法
7．2．2 模擬相位補償法
7．2．3 數(shù)控補償法
7．2．4 ∑一△調(diào)制技術
7．3 小數(shù)分頻器的實用電路
7．3．1 基本小數(shù)分頻器
7．3．2 吞脈沖小數(shù)分頻器
7．4 小數(shù)分頻頻率合成器方案實例
第8章 直接數(shù)字頻率合成器
8．1 直接數(shù)字頻率合成器工作原理
8．1．1 斜升波合成
8．1．2 任意波形的合成
8．1 _3正弦波合成
8．2 DDS的頻譜特性分析
8．2．1 DDS的技術特性
8．2．2 理想情況下DDS輸出頻譜特性
8．2．3 DDS中雜散信號頻譜特性分析
8．3 DDS與PLL混合頻率合成方案
8．3．1 DDS驅(qū)動PLL混合方案
8．3．2 DDS插入PLL混合方案
8．3．3 DDS用作小數(shù)分頻器
8．4 DDS在電子系統(tǒng)中的應用
8．4．1 DDS在數(shù)據(jù)通信中的應用
8．4 -2 DDS在雷達系統(tǒng)中的應用
8．4．3 DDS在電子測量儀器中的應用
8．5 DDS典型芯片介紹
8．5．1 DDS芯片AD9854
8．5．2 DDS芯片Q2368
8．5．3 DDS芯片STEL-1180
第9章 集成頻率合成器
9．1 集成鎖相環(huán)基本電路
9．1．1 集成鑒相器
9．1．2 集成壓控振蕩器
9．1．3 集成雙模分頻器及其他電路
9．2 單片集成鎖相環(huán)
9．2．1 低頻數(shù)字鎖相環(huán)CD4046
9．2．2 高頻單片模擬鎖相環(huán)L562
9．3 集成頻率合成器
9．3．1 并行碼輸入方式的頻率合成器
9．3．2 數(shù)據(jù)總線輸入方式的頻率合成器
9．3．3 串行輸入方式的頻率合成器
9．4 集成頻率合成器的微機控制
9．4．1 串行碼輸入方式頻率合成器的微機控制
9．4．2 數(shù)據(jù)總線輸入方式頻率合成器的微機控制
9．4．3 并行碼輸入方式頻率合成器的微機控制
第10章 全數(shù)字鎖相環(huán)
10．1 全數(shù)字型鑒相器
10．1．1 由觸發(fā)器和計數(shù)器構成的全數(shù)字型鑒相器
10．1．2 奈奎斯特率全數(shù)字型鑒相器
10．1．3 零交叉全數(shù)字型鑒相器
10．2 全數(shù)字環(huán)路濾波器
10．2．1 超前／滯后計數(shù)器式全數(shù)字環(huán)路濾波器
10．2．2 K變模計數(shù)器式全數(shù)字環(huán)路濾波器
10．2．3 N先于M式全數(shù)字環(huán)路濾波器
10．3 數(shù)字控制振蕩器
10．3．1 除Ⅳ可變分頻器式DCO
10．3．2 增量-減量計數(shù)器式DCO
10．3．3 波形合成器式DCO
10．4 全數(shù)字鎖相環(huán)方案
10．4．1 超前／滯后型全數(shù)字鎖相環(huán)
10．4．2 觸發(fā)器型全數(shù)字鎖相環(huán)
10．4．3 全數(shù)字鎖相環(huán)實例
10．5 全數(shù)字鎖相環(huán)的性能
10．5．1 全數(shù)字鎖相環(huán)的離散時間工作特性
10．5．2 全數(shù)字鎖相環(huán)輸出頻率的變化范圍
10．5．3 全數(shù)字鎖相環(huán)的頻域分析
10．5．4 全數(shù)字鎖相環(huán)的紋波消除技術
10．6 軟件鎖相環(huán)
10．6．1 模擬鎖相環(huán)的軟件實現(xiàn)
10．6．2 數(shù)模混合鎖相環(huán)的軟件實現(xiàn)
10．6．3 全數(shù)字鎖相環(huán)的軟件實現(xiàn)
參考文獻