IC設(shè)計(jì)基礎(chǔ)（紅皮）

第1章 IC設(shè)計(jì)基礎(chǔ)
1.1 系統(tǒng)設(shè)計(jì)流程
1.2 ASIC設(shè)計(jì)流程
1.2.1 規(guī)格定義
1.2.2 工藝選擇
1.2.3 架構(gòu)選擇
1.2.4 電路設(shè)計(jì)
1.2.5 設(shè)計(jì)驗(yàn)證
1.2.6 測(cè)試
1.3 FPGA的設(shè)計(jì)
1.3.1 FPGA中邏輯實(shí)現(xiàn)原理
1.3.2 Altera的FPGA
1.3.3 Xilinx的FPGA
1.4 常用軟件的使用
1.4.1 常用軟件的分類(lèi)
1.4.2 Chronology Timing Designer的使用
1.4.3 ModelSim的使用
1.4.4 NC Simulator的使用
1.4.5 FPGA Express的使用
1.4.6 Silicon Ensemble的使用
1.5 Verilog
1.5.1 Verilog語(yǔ)言基礎(chǔ)
1.5.2 基本概念
1.5.3 設(shè)計(jì)仿真
1.5.4 系統(tǒng)任務(wù)及函數(shù)
1.5.5 其它重要的內(nèi)容
1.6 練習(xí)
第2章 時(shí)序電路的設(shè)計(jì)
2.1 時(shí)序邏輯電路
2.1.1 雙穩(wěn)態(tài)電路
2.1.2 單穩(wěn)態(tài)電路
2.1.3 無(wú)穩(wěn)態(tài)電路
2.1.4 施密特觸發(fā)器
2.2 時(shí)鐘策略
2.2.1 全局時(shí)鐘
2.2.2 門(mén)控時(shí)鐘
2.2.3 行波時(shí)鐘
2.2.4 時(shí)鐘偏移
2.2.5 系統(tǒng)級(jí)的同步：鎖相環(huán)
2.3 時(shí)序
2.3.1 時(shí)序圖
2.3.2 建立時(shí)間/保持時(shí)間
2.3.3 靜態(tài)時(shí)序分析中的概念
2.4 總線設(shè)計(jì)
2.4.1 總線寬度
2.4.2 總線時(shí)鐘
2.4.3 總線仲裁
2.4.4 總線操作
2.5 練習(xí)
第3章 綜合
3.1 綜合（Synthesis）的概念
3.2 Design Compiler簡(jiǎn)介
3.3 綜合條件的設(shè)置
3.3.1 操作環(huán)境
3.3.2 導(dǎo)線負(fù)載模型
3.3.3 設(shè)計(jì)約束
3.3.4 設(shè)計(jì)規(guī)則約束
3.3.5 其它
3.4 綜合過(guò)程示例
3.5 綜合的SDF文件
3.6 關(guān)于測(cè)試
3.7 面向綜合的設(shè)計(jì)
3.7.1 速度與面積的優(yōu)化：16位桶形移位寄存器
3.7.2 Net類(lèi)型與Register類(lèi)型
3.7.3 if語(yǔ)句和Case語(yǔ)句的綜合
3.7.4 阻塞賦值與非阻塞賦值
3.7.5 狀態(tài)機(jī)的編碼
3.7.6 使用流水線
3.7.7 設(shè)計(jì)中不期望的鎖存器
3.7.8 對(duì)可綜合設(shè)計(jì)的一些建議
3.8 基本設(shè)計(jì)單元的綜合
3.9 靜態(tài)時(shí)序分析
3.10 練習(xí)
第4章 基本模塊的設(shè)計(jì)
4.1 差錯(cuò)控制編碼
4.1.1 奇偶校驗(yàn)?zāi)K
4.1.2 漢明碼編解碼器
4.1.3 CRC碼
4.2 基本數(shù)學(xué)邏輯
4.2.1 加法器
4.2.2 乘法器
4.2.3 除法器
4.2.4 算術(shù)邏輯單元ALU
4.3 線性反饋移位寄存器
4.3.1 串/并轉(zhuǎn)換模塊的功能
4.3.2 生成偽隨機(jī)數(shù)
4.3.3 產(chǎn)生定時(shí)標(biāo)志信號(hào)
4.4 桶形移位寄存器
4.5 串/并轉(zhuǎn)換模塊
4.6 加解密模塊
4.6.1 簡(jiǎn)單加密模塊
4.6.2 DES加密
4.6.3 其它加密
4.7 信源編碼
4.8 RAM存儲(chǔ)器
4.8.1 RAM的設(shè)計(jì)
4.8.2 雙端口RAM
4.9 DRAM控制器
4.10 SRAM控制器
4.11 異步FIFO
4.12 數(shù)字鎖相環(huán)
4.12.1 簡(jiǎn)單的數(shù)字鎖相環(huán)
4.12.2 較復(fù)雜的鎖相環(huán)
4.13 UART（通用異步收發(fā)器）
4.13.1 簡(jiǎn)單的UART
4.13.2 復(fù)雜的UART
4.14 FIR濾波器
4.15 練習(xí)
第5章 存儲(chǔ)器的結(jié)構(gòu)和設(shè)計(jì)
5.1 基礎(chǔ)知識(shí)
5.1.1 存儲(chǔ)機(jī)制及存儲(chǔ)器類(lèi)型
5.1.2 SRAM
5.1.3 DRAM
5.1.4 FIFO
5.1.5 移位寄存器
5.1.6 CAM
5.1.7 ROM
5.1.8 PROM
5.1.9 NVRWM
5.2 HSPICE介紹
5.2.1 電路設(shè)計(jì)中常見(jiàn)的分析類(lèi)型
5.2.2 HSPICE基礎(chǔ)知識(shí)
5.3 存儲(chǔ)器設(shè)計(jì)
5.4 練習(xí)
第6章 圖像與視頻芯片的設(shè)計(jì)
6.1 色度空間轉(zhuǎn)換器
6.1.1 亮度信號(hào)和色差信號(hào)
6.1.2 RGB-YCbCr的模塊設(shè)計(jì)
6.1.3 YCbCr-RGB的模塊設(shè)計(jì)
6.2 DCT(離散余弦變換)
6.2.1 DCT原理
6.2.2 DCT模塊設(shè)計(jì)
6.3 zigzag掃描
6.3.1 zigzag概念
6.3.2 zigzag模塊設(shè)計(jì)
6.4 量化
6.4.1 量化的概念
6.4.2 量化模塊設(shè)計(jì)
6.5 霍夫曼編碼/解碼
6.5.1 霍夫曼碼原理
6.5.2 霍夫曼碼編碼/解碼模塊設(shè)計(jì)
6.6 JPEG
6.7 MPEG
6.8 VGA控制器
6.8.1 視頻基礎(chǔ)知識(shí)
6.8.2 VGA控制器的設(shè)計(jì)
6.9 練習(xí)
第7章 CPU的設(shè)計(jì)
7.1 基礎(chǔ)知識(shí)
7.2 8位RISC的設(shè)計(jì)
7.3 8位CPU的擴(kuò)展
7.4 16位RISC的設(shè)計(jì)
7.4.1 架構(gòu)
7.4.2 數(shù)據(jù)通路的實(shí)現(xiàn)
7.4.3 控制器的實(shí)現(xiàn)
7.5 商業(yè)RISC介紹
7.5.1 ARM體系結(jié)構(gòu)及實(shí)現(xiàn)
7.5.2 MIPS體系結(jié)構(gòu)
7.6 RISC與CISC
7.7 8051基礎(chǔ)
7.7.1 8051的存儲(chǔ)結(jié)構(gòu)
7.7.2 8051的指令集
7.8 8051的設(shè)計(jì)
7.8.1 設(shè)計(jì)要求
7.8.2 架構(gòu)規(guī)劃
7.8.3 時(shí)序規(guī)劃
7.8.4 低功耗方式和時(shí)鐘生成模塊
7.8.5 控制模塊的設(shè)計(jì)
7.8.6 數(shù)據(jù)通路部分的設(shè)計(jì)
7.8.7 定時(shí)器/計(jì)數(shù)器的設(shè)計(jì)
7.8.8 串口的設(shè)計(jì)
7.8.9 中斷控制系統(tǒng)
7.9 練習(xí)
參考文獻(xiàn)