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內(nèi)容簡(jiǎn)介

　　本書全面介紹了可編程邏輯器件如PLD、CPLD、FPGA等的硬件結(jié)構(gòu)，詳細(xì)介紹了ABEL-HDL和VHDL兩種硬件描述語(yǔ)言，具體講解了ISP Synario System、MAX+PLUSII和Foundation三種常用可編程邏輯器件開發(fā)系統(tǒng)的使用方法，同時(shí)還介紹了數(shù)字系統(tǒng)設(shè)計(jì)的一般描述方法和設(shè)計(jì)過程。結(jié)合可編程邏輯器件的硬件描述語(yǔ)言和軟件開發(fā)系統(tǒng)，書中給出了大量的可編程邏輯器件設(shè)計(jì)應(yīng)用實(shí)例，可作為讀者更深入理解可編程邏輯設(shè)計(jì)技術(shù)的參考。本書可作為從事計(jì)算機(jī)應(yīng)用、電子工程和自動(dòng)控制等專業(yè)的工程技術(shù)人員的參考書，也可作為高等院校相關(guān)專業(yè)的教材。為了便于學(xué)習(xí)，本書還配有多媒體學(xué)習(xí)軟件（光盤）。

作者簡(jiǎn)介

暫缺《可編程邏輯設(shè)計(jì)技術(shù)及應(yīng)用》作者簡(jiǎn)介

圖書目錄

第一章可編程邏輯器件
1.1 可編程邏輯器件基礎(chǔ)
1.1.1 可編程邏輯器件的基本結(jié)構(gòu)
1.1.2 可編程邏輯器件的分類及特點(diǎn)
1.1.3 可編程邏輯器件的有關(guān)邏輯約定
1.2 可編程只讀存儲(chǔ)器PROM
1.2.1 一次可編程只讀存儲(chǔ)器
1.2.2 可重復(fù)編程只讀存儲(chǔ)器
1.3 可編程陣列邏輯PAL
1.3.1 PAL器件的基本結(jié)構(gòu)
1.3.2 PAL器件的輸出及反饋結(jié)構(gòu)
1.3.3 PAL器件實(shí)例介紹
1.4 可編程通用陣列邏輯GAL
1.4.1 GAL器件的基本結(jié)構(gòu)
1.4.2 GAL器件的控制字
1.4.3 GAL器件行地址分配
1.4.4 GAL器件命名及性能特點(diǎn)
第二章可編程邏輯器件開發(fā)設(shè)計(jì)
2.1 ABEL硬件描述語(yǔ)言
2.1.1 ABEL語(yǔ)言的語(yǔ)法規(guī)定
2.1.2 ABEL源文件的基本格式
2.1.3 ABEL語(yǔ)言的語(yǔ)句
2.1.4 ABEL語(yǔ)言的指示字
2.2 ABEL軟件開發(fā)工具
2.2.1 ABEL軟件開發(fā)系統(tǒng)
2.2.2 PLD通用編程器
2.3 PLD應(yīng)用設(shè)計(jì)
2.3.1 PROM應(yīng)用設(shè)計(jì)
2.3.2 GAL器件應(yīng)用設(shè)計(jì)
第三章在系統(tǒng)可編程技術(shù)
3.1 在系統(tǒng)可編程邏輯器件
3.1.1 高密度在系統(tǒng)可編程邏輯器件
3.1.2 在系統(tǒng)可編程通用數(shù)字開關(guān)
3.1.3 ISP器件的編程方式
3.2 ISP器件開發(fā)系統(tǒng)
3.2.1 設(shè)計(jì)流程
3.2.2 系統(tǒng)進(jìn)入
3.2.3 原理圖輸入方式
3.2.4 編譯過程
3.2.5 功能仿真
3.2.6 用戶宏元件符號(hào)的建立
3.2.7 ABEL-HDL語(yǔ)言輸入方式
3.2.8 混合輸入方式
3.2.9 JED文件生成與下載
3.2.10 ispGDS器件的編程
3.3 在系統(tǒng)可編程邏輯器件應(yīng)用設(shè)計(jì)
3.3.1 可預(yù)置十進(jìn)制減法計(jì)數(shù)器
3.3.2 脈沖分配器
3.3.3 序列信號(hào)發(fā)生器
3.3.4 簡(jiǎn)易周期信號(hào)測(cè)試儀
第四章 VHDL程序設(shè)計(jì)及應(yīng)用
4.1 VHDL語(yǔ)言
4.1.1 VHDL的程序結(jié)構(gòu)
4.1.2 VHDL的語(yǔ)言元素
4.1.3 VHDL的基本語(yǔ)句
4.1.4 VHDL的子程序
4.2 VHDL程序設(shè)計(jì)實(shí)例
4.2.1 組合邏輯電路的設(shè)計(jì)
4.2.2 時(shí)序邏輯電路的設(shè)計(jì)
4.2.3 狀態(tài)機(jī)的設(shè)計(jì)
4.3 MAX+PLUSII軟件開發(fā)系統(tǒng)
4.3.1 設(shè)計(jì)輸入
4.3.2 設(shè)計(jì)項(xiàng)目的編譯
4.3.3 設(shè)計(jì)校驗(yàn)
4.3.4 器件編程
第五章現(xiàn)場(chǎng)可編程門陣列FPGA
5.1 FPGA的基本結(jié)構(gòu)
5.1.1 XC2000/XC3000FPGA基本結(jié)構(gòu)
5.1.2 XC4000系列FPGA基本結(jié)構(gòu)
5.1.3 FPGA整體結(jié)構(gòu)舉例
5.1.4 XilinxFPGA其它系列簡(jiǎn)介
5.2 Xilinx FPGA的開發(fā)系統(tǒng)
5.2.1 XilinxFPGA的一般設(shè)計(jì)流程
5.2.2 Foundation Series開發(fā)系統(tǒng)簡(jiǎn)介
5.2.3 Xilinx Foundation安裝
5.2.4 Foundation設(shè)計(jì)流程
5.2.5 VHDL輸入方式設(shè)計(jì)
第六章數(shù)字系統(tǒng)設(shè)計(jì)
6.1 數(shù)字系統(tǒng)設(shè)計(jì)概述
6.1.1 數(shù)字系統(tǒng)的組成
6.1.2 數(shù)字系統(tǒng)設(shè)計(jì)方法
6.1.3 數(shù)字系統(tǒng)設(shè)計(jì)的一般過程
6.2 數(shù)字系統(tǒng)的描述方法
6.2.1 寄存器傳輸語(yǔ)言
6.2.2 算法狀態(tài)機(jī)圖（ASM圖）
6.2.3 備有記憶文檔的狀態(tài)圖（MDS）
6.3 數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例
6.3.1 自動(dòng)交通控制系統(tǒng)
6.3.2 二進(jìn)制除法器
6.3.3 樂曲演奏器